逻辑内建自测移相器的设计与优化

来源 :电路与系统学报 | 被引量 : 0次 | 上传用户：ciha

【摘要】

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逻辑内建自测(LogicBIST)测试结构是今后系统芯片(SOC)设计中芯片测试的发展方向.由于LFSR(线性反馈移位寄存器)生成的伪随机序列的高相关性导致故障覆盖率达不到要求,采用移

【作者】

：

梁骏胡海波张明

【机构】

：

浙江大学信电系

【出处】

：

电路与系统学报

【发表日期】

：

2004年4期

【关键词】

：

LFSR BIST 移相器 SOC DFT(可测性设计) LFSR BIST PHASE SHIFTER SOC DFT

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逻辑内建自测(LogicBIST)测试结构是今后系统芯片(SOC)设计中芯片测试的发展方向.由于LFSR(线性反馈移位寄存器)生成的伪随机序列的高相关性导致故障覆盖率达不到要求,采用移相器可以降低随机序列的空间相关性,提高LogicBIST的故障覆盖率.本文分析了移相器的数学理论并提出了移相器设计与优化算法.该算法可以得到最小时延与面积代价下的高效移相器.

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