LVDS分离器简化高速信号分配

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近年来 ,随着微处理器、DSP、数字ASIC时钟频率的提高 ,在一些新兴领域中 ,背板信号的数据速率和总线吞吐率也在稳步提高。而速率的提高使得基于TTL单端信号的功耗大、有抖动和高电平辐射等缺点越来越突出 ,尽管一些报道认为利用这种标准速率能够保持在50MHz以 In recent years, with the increase of microprocessor, DSP, and digital ASIC clock frequency, the data rate and bus throughput of backplane signals have also been steadily increasing in some emerging fields. However, the increase of the rate makes the disadvantages of the TTL single-ended signal, such as large power consumption, jitter and high-level radiation, more and more prominent. Although some reports consider that the standard rate can be kept at 50 MHz
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