一种FPGA实现中时钟偏移(skew)的快速修复方法

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通常在使用FPGA综合工具进行综合设计时,将时钟信号配置在全局时钟网络上,可有效抑制时钟偏移现象.但是为了保证和专用集成电路的结构一致,或者受到锁相环数量的限制,需要采用触发器作为分频电路.这样不可避免的会导致主时钟和分频时钟之间的偏移(skew)过大.针对该问题,本文提出了一种时钟偏移的快速修复方法,该方法通过手动插入时钟延迟链、将时钟模块锁定在指定区域以及手动给时钟分配全局缓冲器(global buffer)等手段,精确控制主时钟和分频时钟的相对时延,从而达到减少两个时钟之间的偏移的目的,进而满足高速
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