【摘 要】
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利用Verilog语言在FPGA内设计了一种实时高精度增量式编码器信号采集系统,实现了编码器信号的四倍频、计数,与DSP高速通信等功能,并精简了系统电路。同时分析、减小伺服系统
【机 构】
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中国科学技术大学自动化系,常州先进制造技术研究所
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利用Verilog语言在FPGA内设计了一种实时高精度增量式编码器信号采集系统,实现了编码器信号的四倍频、计数,与DSP高速通信等功能,并精简了系统电路。同时分析、减小伺服系统在实际运行中采集编码器数据时产生的误差。最后通过在ModelSim下软件仿真和Altera公司EP2C8Q208C芯片上硬件测试,验证计数与传输的准确性。
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