基于协议控制器的DDR3访存控制器的设计及优化

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为了完成SoC系统中片外DDR3存储器高效访问,实现了基于协议控制器的DDR3访存控制器.针对SoC系统层访问事务属性与DDR3存储器突发访问属性要求之间的不匹配问题,设计了一种访问请求平滑处理机制,充分利用协议控制器的DDR3访问命令缓冲,用更少的DDR3存储器访问请求完成SoC上层读写事务,提高了整个DDR3访存控制器的访问效率.采用Verilog语言完成了逻辑设计和物理实现,并采用人工综合激励的方法对访问请求平滑机制进行了评估,实验证明该优化机制可对DDR3访存控制器实现有效加速.
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