【摘 要】
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本论文的设计工作来源于西安深亚电子有限公司的设计产品，论述了以太网接口芯片的系统设计与实现。论文中系统地阐述了数字集成以太网接口芯片EOE1的体系结构和工作原理，在设计
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本论文的设计工作来源于西安深亚电子有限公司的设计产品，论述了以太网接口芯片的系统设计与实现。论文中系统地阐述了数字集成以太网接口芯片EOE1的体系结构和工作原理，在设计过程中，充分考虑了时钟同步问题，并结合了市场需要修定了设计指标和功能要求，对Ethemet及E1知识加以简单的介绍，并对同步电路设计进行了重点研究，然后介绍了芯片的具体功能及性能。文中对性能测试的方案进行了详细设计，并分析测试结果，改进了测试方案，更好地验证芯片性能。整个设计利用Verilog语言进行了描述，并用Cadence的NC-Verilog对电路进行了仿真验证。目前，所设计的以太网接口芯片EOE1己通过FPGA验证。
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