基于FPGA的OFDM基带系统中卷积码编译码器的研究与实现

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现如今OFDM技术已经成为多个通讯标准的物理层接入技术,并被视为是第四代移动通信系统的关键技术之一,具越来越有广阔的应用前景。IEEE 802.11a是应用OFDM技术作为物理层接入技术的无线局域网标准.。其采用生成函数为G(133.171)8的(2.1.7)卷积码作为其信道编码方案。卷积码编码器和Viterbi译码器作为IEEE802.11a协议下基带处理的重要组成部分,其运行速度和功耗对整个系统的性能有着至关重要的作用。文章对OFDM技术进行了分析,给出了OFDM基带系统的基本模型,对IEEE820.11a中的差错控制编码进行了讨论,在此基础上完成了多码率卷积码编码器和Viterbi译码器的FPGA实现。多码率卷积码编码器能满足1/2、2/3、3/4三种码率,且具有很高的编码速度,新设计的Viterbi译码器有以下特点:(1).采用矢量差的“1范数”代替欧氏距离作为软判决译码距离减小了硬件开销、(2).以一种改进的归一化管理高效的解决了PUM单元的数据溢出问题、(3).采用一种分块循环回溯算法降低了延时。文中详述了多码率卷积码编码器和改进的Viterbi译码器的硬件结构及参数的确定,并给出了部分模块的Verilog源代码和综合报告,以及相应的仿真结果分析。实验表明在该译码器以较少的资源实现了较快的速度,完全满足IEEE802.11a的协议标准,可以作为OFDM基带系统的一个子模块,具有较高的实用价值。
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