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以计算机为基本工作平台,以VHDL为系统逻辑描述的主要表达方式,以FPGA为设计载体,设计出了通信系统中同步码组码型的检测系统,应用QuartusⅡ7.2的综合器和仿真器对系统进行了编译和仿真,并得出了正确的仿真结果。
基于QuartusⅡ的码型检测器的设计与仿真
【摘 要】
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以计算机为基本工作平台,以VHDL为系统逻辑描述的主要表达方式,以FPGA为设计载体,设计出了通信系统中同步码组码型的检测系统,应用QuartusⅡ7.2的综合器和仿真器对系统进行了
【机 构】
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常州轻工职业技术学院
【出 处】
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科技情报开发与经济
【发表日期】
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2010年2期
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