【摘 要】
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采用现场可编程门阵列(FPGA),设计了一种用于SDH传输系统中数据通信通道(DCC)数据帧汇聚与速率适配的电路.可以将具有不同时钟的12个独立DCC通道中的HDLC数据帧进行提取、缓
【机 构】
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东南大学射频与光电集成电路研究所,东南大学射频与光电集成电路研究所,解放军理工大学通信工程学院
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采用现场可编程门阵列(FPGA),设计了一种用于SDH传输系统中数据通信通道(DCC)数据帧汇聚与速率适配的电路.可以将具有不同时钟的12个独立DCC通道中的HDLC数据帧进行提取、缓存并复接成一个时分复用的高速数据链路,交给Motorola MPC860中的多通道通信控制器进行处理.整个设计采用一片XILINX 的xc2s200pq208完成,使用约17万等效门,在HDLC最大帧长为1kB的情况下,允许的多通道通信控制器与DCC 通道时钟之间的时钟偏差大于1.4%,并给出了测试波形.
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