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阐述了基于VXI总线的高精度时钟源模块的组成框图及基本原理,由FPGA器件实现VXI总线寄存器基接口电路及控制功能,采用AD9850 DDS(直接数字频率合成器)实现高精度分频功能,提出了用ECL器件实现延迟调节与输出驱动的设计方法,具有经济实用的特点.
一种VXI总线高精度时钟源的设计
【摘 要】
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阐述了基于VXI总线的高精度时钟源模块的组成框图及基本原理,由FPGA器件实现VXI总线寄存器基接口电路及控制功能,采用AD9850 DDS(直接数字频率合成器)实现高精度分频功能,提
【机 构】
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军械工程学院光学与电子工程系,科研部
【出 处】
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军械工程学院学报
【发表日期】
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2002年4期
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