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本设计用VHDL语言在FPGA器件上实现数字频率计的设计,其测频范围是0～1MHz,分三个量程。能够用数码管显示被测信号的频率,而且具有量程自动切换功能。在软件平台MAX＋PLUSⅡ环境下通过了编译、仿真,并下载到FPGA器件上验证其正确性。
基于FPGA的数字频率计设计与仿真
【摘 要】
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本设计用VHDL语言在FPGA器件上实现数字频率计的设计,其测频范围是0～1MHz,分三个量程。能够用数码管显示被测信号的频率,而且具有量程自动切换功能。在软件平台MAX＋PLUSⅡ环境
【机 构】
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内蒙古科技大学信息学院
【出 处】
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科技资讯
【发表日期】
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2008年33期
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