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为了实现模拟简易电子钟的功能,以FPGA,Verilog语言为基础,具体包含时钟主控模块,分频模块,七段译码器显示模块实现了对电子钟的设计,验证效果良好。
基于FPGA的简易电子钟设计
【摘 要】
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为了实现模拟简易电子钟的功能,以FPGA,Verilog语言为基础,具体包含时钟主控模块,分频模块,七段译码器显示模块实现了对电子钟的设计,验证效果良好。
【机 构】
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大连理工大学城市学院
【出 处】
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电脑知识与技术
【发表日期】
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2019年2X期
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