【摘 要】
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随着通信技术的发展,通过卫星提供数据、视频的高速数据传输系统得到快速发展,模数转换器(A/D)也得到了广泛应用。然而,模数转换器在处理高频信号时,对采样时钟误差即时钟抖
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随着通信技术的发展,通过卫星提供数据、视频的高速数据传输系统得到快速发展,模数转换器(A/D)也得到了广泛应用。然而,模数转换器在处理高频信号时,对采样时钟误差即时钟抖动(jitter)特别敏感,极小的抖动都会使信噪比(SNR)大幅下降。通过对信噪比、有效位数(ENOB)和时钟抖动之间的相互关系进行理论研究和公式推导,提出一种超低抖动的时钟电路设计方案,并对方案进行器件选型、理论计算、原理设计和测试验证。结果表明,该时钟设计方案满足高速模数转换器的使用要求。
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