【摘 要】
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采用直接数字频率合成（DDS）技术设计的Loran—C信号源，具有输出杂散多且难以预测的缺点。基于对DDS基本原理的研究分析，针对DDS输出信号存在的相位舍位杂散问题，对其关键部位的相
【机 构】
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中国科学院国家授时中心,中国科学院精密导航定位与定时技术重点实验室,中国科学院大学
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采用直接数字频率合成（DDS）技术设计的Loran—C信号源，具有输出杂散多且难以预测的缺点。基于对DDS基本原理的研究分析，针对DDS输出信号存在的相位舍位杂散问题，对其关键部位的相位累加模块进行优化设计，并基于FPGA技术，在QuartusII环境下完成了对Loran．C信号源的实现与仿真验证。结果表明，通过优化的设计算法能够产生失真小，稳定度好的输出波形，从而验证了该方法抑制杂散的有效性与可行性。
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