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浮点连续乘-加、混合乘-加和三操作数加等浮点算术运算在科学计算领域中应用越来越频繁，为设计一款支持浮点连续乘-加、混合乘-加和三操作数加的多功能浮点运算单元，提出一种可重构浮点混合/连续乘-加器，通过对控制位的配置可以实现多种浮点数据操作。该乘-加器采用8级流水线，可以实现单周期的浮点乘累加，大幅提高数据处理吞吐量，同时支持三操作数加和两操作数和的累加。在Modelsim SE6.6f中对该设计进行仿真验证，结果表明其能够在Xilinx Virtex-6 FPGA上实现，资源消耗2631个LUT，频率可达