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ASIC系统中跨时钟域配置模块的设计与实现
ASIC系统中跨时钟域配置模块的设计与实现
来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户:ptcptsu
【摘 要】
:
本文概述了ASIC系统中跨时钟域配置模块的多种设计方案以及实现方法,并且着重对分析由于跨时钟域带来的异步时钟问题进行了分析,提出了避免'潜在逻辑错误'发生的解决
【作 者】
:
杜旭
左剑
夏晓菲
何建华
【机 构】
:
华中科技大学
【出 处】
:
微电子学与计算机
【发表日期】
:
2004年6期
【关键词】
:
ASIC
跨时钟域
异步时钟
亚稳态
自清零寄存器
ASIC
Cross Clock Domain
Asynchronous Clock
Metastab
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本文概述了ASIC系统中跨时钟域配置模块的多种设计方案以及实现方法,并且着重对分析由于跨时钟域带来的异步时钟问题进行了分析,提出了避免'潜在逻辑错误'发生的解决方案.同时研究了设计方案对后端实现中可能出现的影响,避免了不合理的前端设计给后端实现带来的困难.
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