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在数字通信的数据传输过程中,需要保持数据在传输过程中的同步,因此要在数据传输过程中插入帧同步字进行检测,从而有效避免发送数据和接收数据在传输过程中出现的异步问题。文中提出了一种采用流水线技术、基于FPGA设计高速数字相关器的方法。仿真结果表明设计方案是可行的。
基于FPGA的高速数字相关器设计
【摘 要】
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在数字通信的数据传输过程中,需要保持数据在传输过程中的同步,因此要在数据传输过程中插入帧同步字进行检测,从而有效避免发送数据和接收数据在传输过程中出现的异步问题。
【机 构】
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琼州学院物理系,海南大学信息科学技术学院
【出 处】
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微计算机信息
【发表日期】
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2009年17期
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