【摘 要】
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设计了一种基于现场可编程门阵列(Field Programmable Gate Array,FPGA)的紧凑型1024点流水线架构快速傅里叶变换(Fast Fourier Transform,FFT)处理器.采用基-25 FFT算法用于减少旋转因子复数乘法运算的复杂度,硬件实现上采用了单路延迟负反馈(Single Delay Feedback,SDF)流水线架构.提出了旋转因子拆分方案,将旋转因子W i1024拆分为W 11024和W i512,使得所有的复数乘法运算全部由正则有符号数(Canonical
【机 构】
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河北民族师范学院 物理与电子工程学院,河北 承德 067000;中国电子科技集团公司第五十四研究所,河北 石家庄 050081;北京邮电大学,北京 100876
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设计了一种基于现场可编程门阵列(Field Programmable Gate Array,FPGA)的紧凑型1024点流水线架构快速傅里叶变换(Fast Fourier Transform,FFT)处理器.采用基-25 FFT算法用于减少旋转因子复数乘法运算的复杂度,硬件实现上采用了单路延迟负反馈(Single Delay Feedback,SDF)流水线架构.提出了旋转因子拆分方案,将旋转因子W i1024拆分为W 11024和W i512,使得所有的复数乘法运算全部由正则有符号数(Canonical Signed Digit,CSD)常数乘法器来完成,无需任何只读存储器(Read Only Memory,ROM)对旋转因子常数值进行存储,大幅降低了设计所消耗的硬件成本.评估结果显示,与以往的设计方案相比,所提方案至少节约逻辑单元使用量(Logic Elements,LEs)28％,记忆体单元使用量(Memory bits,MBs)48％.
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