【摘 要】
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设计一个实时图像放大引擎IP（Intellectual Property）核,该IP核以最小化硬件资源占用和最短的时钟周期消耗,快速实现预定比例的图像放大。用VHDL（Very-High-Speed Integrated Ci
【机 构】
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空军航空大学基础实验中心,空军航空大学教育技术中心,吉林大学物理实验中心
【基金项目】
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国家自然科学基金资助项目(60372058,60772101)
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设计一个实时图像放大引擎IP（Intellectual Property）核,该IP核以最小化硬件资源占用和最短的时钟周期消耗,快速实现预定比例的图像放大。用VHDL（Very-High-Speed Integrated Circuit Hardware Description Language）语言描述,可结合到各种显示输出集成电路芯片中。提出一种简化的D1到XGA（Extended Graph-ics Array）格式转换的有效算法;在此基础上给出算法基于FPGA（Field Programmable
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