【摘 要】
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为了提高基于FPGA与ASIC的准循环低密度奇偶校验码(QC-LDPC)部分并行结构译码器译码效率和吞吐量,提出了一种节点延时并行(NDPA)算法。与标准的LDPC译码算法相比,该算法根据
【机 构】
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上海大学通信与信息工程学院,中科院上海高等研究院
【基金项目】
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下一代广播电视无线网单向广播信道物理层传输标准研究(18DZ2203900).
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为了提高基于FPGA与ASIC的准循环低密度奇偶校验码(QC-LDPC)部分并行结构译码器译码效率和吞吐量,提出了一种节点延时并行(NDPA)算法。与标准的LDPC译码算法相比,该算法根据校验矩阵的结构特点,利用已经更新的一部分校验节点的信息直接更新变量节点,使得新信息可以更及时地进入迭代更新过程,从而提高译码效率。同时,与现有分层译码算法(LDA)相比,基于所提算法实现的译码器可通过校验节点和变量节点的并行计算操作,压缩单次迭代所需时间,进而可有效提升译码器的吞吐量。
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