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在数据通信中为了降低通信线路传输的误码率，需要采用高效能的差错控制方法。循环冗余校验（CRC）由于其误码检测能力强，抗干扰性能优异，在通信和测控等领域有广泛的应用。通过对CRC校验码原理的分析，研究了一种并行CRC算法并采用硬件描述语言Verilog HDL来实现。
基于FPGA的循环冗余校验并行实现
【摘 要】
：
在数据通信中为了降低通信线路传输的误码率，需要采用高效能的差错控制方法。循环冗余校验（CRC）由于其误码检测能力强，抗干扰性能优异，在通信和测控等领域有广泛的应用。通过对CRC
【机 构】
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贵州大学电子科学与信息技术学院
【出 处】
：
信息技术
【发表日期】
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2009年6期
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